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dep12 소자 사용 중 DC 수렴 문제가 발생하여 문의드립니다. call.scs에 tw_dep12 정의가..

del library=~/pdk_analog/BCD1370HP_Spectre_A00-V0.1.2.2/Spectre/BCD1370HP_Spectre.l..

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dep~  소자의 DC convergence문제 확인하였습니다.   삼성에 PDK관련하여 문..

dep** 소자를 이용한 simulation에서 conversion error발생한 이슈가 있었는데 이부분은..

안녕하세요. IdeC 조인신입니다.     tool 을 설치한 서버와 실행한 서버..

   툴을 설치한 서버와 실행한 서버 모두 동일한 서버입니다. 혹시 저희..

aoi_cal_2024.1_36.20 버전을 CentOS 7.9 에 설치해보니  동일한 문제로 실행이 되..

  답변감사드립니다. 말씀하신대로 Rocky8에서 다시 시도해보도록 하겠습니다. [..

     안녕하세요 한양대  IdeC입니다. 문의주신 내용 확인하여 ..

de pdf 파일이 있으니  이 파일의 내용을 참고하여 RUN_LNM28FDS_FILL.csh 파..

dence Xcelium/Genus를 이용한 RTL 개발 및 로직 합성의 기초" 교육부분에 대해 추가개설..

dence Xcelium/Genus를 이용한 RTL 개발 및 로직 합성의 기초" 교육은 올해 개설 계획이 ..

안녕하세요, KAIST 김봉진 교수님 연구실 소속 석사과정 김현중입니다.   merge ..

안녕하세요. IdeC 조인신입니다.     설정의 내용을 보니 UTM 을 사..

답변 감사합니다. 덕분에 바로 해결했습니다!   한가지 추가로 여쭙고 싶은 것이 ..

JQ 와 IO 의 위치는 pad 에 붙일 I/O cell 의 layer(IB, VV 등) 를 감안하여 배치한 것입..

안녕하세요 IdeC 담당자님, SF28-2402 회차 (11조 YSKTR) 설계에 참여한 연세대학교 정성..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

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안녕하세요 경북대 IdeC 입니다. 추가 신청 계획은 아직 없습니다. 일단 신청 기간이 ..

안녕하세요 경북대 IdeC 입니다. 저희는 대기자 신청을 하고 있지 않습니다. 일단 신..

 안녕하세요 전남대IdeC 입니다   대기자로 신청하시고 현재 대기자 상태이..

안녕하세요 경북대 IdeC 입니다. 증원 예정은 없습니다. 아직 수강신청 기간 중이니 ..

[Synposys] Multi-Voltage design 구현을 위한 Synopsys low power 설계 (PnR) 과정에서 ..

  안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 ..

안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 신청받았..

안녕하세요 부산대IdeC입니다. 해당강좌 20명 정원 대기자 10명까지 신청할 수 있습니..

 안녕하세요 전남대 IdeC입니다   문의주신 강좌의 경우 현재 추가 증..

dence : Virtuoso, Spectre3) Siemens EDA : Calibre, Questa (구 ModelSim) 외 &nb..

IC design Education Center(IdeC)   (채용) KAIST 반도체..

 충북대IdeC강의의 경우, 충북대 내 IC경진대회에 참여하는 학생들의 경우 우선수강..