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기존의 cds.lib 파일을 삭제하거나 cds.lib_ori 처럼 파일명을 변경한 후 virtuoso 를 ..

debug log는 다음과 같습니다. 09/01/2020 18:36:39 (snpslmd) -----------------------..

debug log는 다음과 같습니다. 09/01/2020 18:36:39 (snpslmd) -----------------------..

debug log를 살펴보니 포트 번호가 바뀌고 있는 것으로 보입니다.   [조인신..

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안녕하세요. IdeC 연구원 조인신입니다.   올해 TCAD 교육은 코로나의 영향..

  IdeC 선혜승입니다     CONSTRAINT 파일 SDC 를 물리지 않았나..

prime time에서 pt_shell을 하면 library compiler executable path is not set. 이라고 ..

del 이 자동으로 정해지는 것이고   operating condition은  설계자 스..

안녕하세요. IdeC 연구원 조인신입니다.   문의한 것과 같은 Technologyt Tool b..

dence virtuoso: IC618                 ..

de 해줘야 하는 파일, PEX 과정 등에 대해서는 PDK 를 제공받은 곳에 문의를 해보시는 ..

de 해줘야 하는 파일, PEX 과정 등에 대해서는 PDK 를 제공받은 곳에 문의를 해보시는 ..

   부산대IdeC입니다  아이디 ' user' 8-31일 오전부터 종료시까지 온..

안녕하세요 s65 진행중인 석사생 이재은입니다.   ICC로 01_floorplan을 진..

    IdeC 선혜승입니다     에러가 아니면 넘어가도 되는..

der 등에 대한 power simulation이 가능한지요? 감사합니다.

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

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안녕하세요 경북대 IdeC 입니다. 추가 신청 계획은 아직 없습니다. 일단 신청 기간이 ..

안녕하세요 경북대 IdeC 입니다. 저희는 대기자 신청을 하고 있지 않습니다. 일단 신..

 안녕하세요 전남대IdeC 입니다   대기자로 신청하시고 현재 대기자 상태이..

안녕하세요 경북대 IdeC 입니다. 증원 예정은 없습니다. 아직 수강신청 기간 중이니 ..

[Synposys] Multi-Voltage design 구현을 위한 Synopsys low power 설계 (PnR) 과정에서 ..

  안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 ..

안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 신청받았..

안녕하세요 부산대IdeC입니다. 해당강좌 20명 정원 대기자 10명까지 신청할 수 있습니..

 안녕하세요 전남대 IdeC입니다   문의주신 강좌의 경우 현재 추가 증..

dence : Virtuoso, Spectre3) Siemens EDA : Calibre, Questa (구 ModelSim) 외 &nb..

IC design Education Center(IdeC)   (채용) KAIST 반도체..