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'인공지능 반도체설계 기술의 이해'수업을 어제 완료하고 어제 8시에 오픈을 해주신다 하..

안녕하세요, 광운대학교 IdeC입니다.  문의 내역을 확인하고 조처를 진행하였습니..

 확인해본 결과 아직도 결석처리가 되어있는 것 같습니다. 재확인 부탁드려도 될까..

안녕하세요, 광운대학교 IdeC입니다.  교육신청자 차단명단에서는 해제를 진행하였..

안녕하세요. IdeC 연구원 조인신입니다.   뭔가가 파일들이 꼬이거나 엉킨 상황..

 안녕하세요 종료후 재실행해도 똑같은상황이라   LVS 디렉토리 파일을 다 ..

LVS 시 지정한 LVS rule directory 를 삭제한 후 다시 진행해 보시기 바랍니다. &n..

 안녕하세요    LVS directory 삭제후 다시 진행하여도 똑같은 에러가 ..

LVS runset 을 load 하여 사용하는 상황이라면 해당 runset 에 설정을 무엇인가 수..

  안녕하세요  LVS RUNSET을 하지않고 LVS RULES FILE로 불러와서 사용하고..

동일한 설정으로 어떤 layout 은 LVS 가 되고 어떤 layout 은 문제가 발..

IdeC 시스템상에서 따로 메일이 전송되는지는 파악이 안됩니다. 강의는 정상적으로 신청..

안녕하세요. IdeC 연구원 조인신입니다.   문제의 원인이 무엇인지는 첨부한 파..

device)    현재 모양과 Sde -> SDvice의 TMM 계산할당 및 전체적인 ..

device)    현재 모양과 Sde -> SDvice의 TMM 계산할당 및 전체적인 ..

안녕하세요. IdeC 연구원 조인신입니다.   우선 lmstat 로 라이선스 데몬의 구동..

 안녕하세요. 경희대학교 김상혁교수님 연구실 석사과정 박홍현입니다. lmstat로 ..

정확한 확인을 위해 라이선스 데몬 log 파일을 확인해 보는 것이 좋을 것 같습니다. 라..

design에서는 strap과 rectangular ring이 만나서 생기는 문제 같습니다. mem의 blockag..

design에서는 strap과 rectangular ring이 만나서 생기는 문제 같습니다. mem의 blockag..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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본 연구는 IdeC에서 EDA Tool를 지원받아 수행하였습니다.

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dent Research Preview   - 2월 16일(월): Plenary 4편, Regular Technical Se..

본 연구는 IdeC에서 EDA Tool를 지원받아 수행하였습니다.

CURRENT OFFSET deTECTION AMPLIFIER CIRCUIT FOR PUF BASED ON MAGNETORESISTIVE RANDOM..

DUAL MOde INVERTER-BASED WRITE TERMINATION CIRCUIT, METHOD THEREOF, AND deVICES HAV..