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첨부한 파일을 보니 2019.4 버전으로 확인이 됩니다. 버전이 높은 경우 .cdsinit ..

  말씀해주신대로 .cdsinit 파일의 마지막부분에 첨부해주신 코드문을 붙여넣고 실..

환경 설정 파일을 수정 후 재 soucing (source 파일명 엔터) 하여 내용이 적용되게 한 후..

declare -x PATH= 경로가 다 적용되어 있습니다. 그런데 아직까지도 같은 에러 문구가 나..

declare -x PATH= 경로가 다 적용되어 있습니다. 그런데 아직까지도 같은 에러 문구가 나..

안녕하세요. IdeC 연구원 조인신입니다.   환경 설정 파일의 내용에 문제가 있어..

   감사합니다  해결하였습니다.   [조인신]님의 글 ==========..

  IdeC 선혜승입니다   solvnet 에서 받을 수 있는 라이브러리는  Dig..

dence 공부를 막 시작한 한동대학교 강민교입니다 간단한 질문인데, 주변에 물어볼 사람..

dence 공부를 막 시작한 한동대학교 강민교입니다 간단한 질문인데, 주변에 물어볼 사람..

defined model or subcircuit, `lvsres'. Either include the file containing the defin..

de 하면 됩니다. ex) simulator lang=spectreinclude "/파일의경로/sub.cdl"   ..

de 하면 됩니다. ex) simulator lang=spectreinclude "/파일의경로/sub.cdl"   ..

de 를 읽어보니 4개의 thread 당 one parallel license 가 필요하다고 되어 있는데 제가..

device-parallel feature 가 라이선스 파일안에 따로 있으며, 2–4 threads ..

안녕하세요. IdeC 연구원 조인신입니다.   /etc/hosts 파일에 사용하고 있..

design compiler로 synthesis할 때 timing constraint에서 헷갈리는 것이 있어 질문드립..

design compiler로 synthesis할 때 timing constraint에서 헷갈리는 것이 있어 질문드립..

design compiler로 synthesis할 때 timing constraint에서 헷갈리는 것이 있어 질문드립..

design compiler로 synthesis할 때 timing constraint에서 헷갈리는 것이 있어 질문드립..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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dec 담당자님. IC설계를 함에 있어 노이즈 분야에 대해 잘 아는것이 상당히 중요한 것으..

dec 담당자님. IC설계를 함에 있어 노이즈 분야에 대해 잘 아는것이 상당히 중요한 것으..

7월 25일에 시작하는 Physical design 설계 자동화 알고리즘 입문은 동영상강의로 업로드..

안녕하세요.   Microsemi FPGA 및 Libero Ide/Soc 관련 교육 개설 신청합니다. ..

Power-aware DFT and BIST design Methodology for SOC Testing 강의 개설 희망합니다!

  안녕하세요.   IdeC충북대지역센터입니다.    문의주신 강좌..

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