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default 로 verilog 파일에 들어가 있는 setuphold 조건을 참조하게 되는 것 같습니다. ..

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delay 가 999 가 되는 조건도 모두 나오나 봅니다    감사합니다  &nb..

  IdeC 선혜승입니다     지금 열었으니  5시 30분부터 6시..

   작업 완료했습니다! 감사합니다!   [선혜승]님의 글 =============..

   넵 사용 후 글 올리도록 하겠습니다 감사합니다.   [선혜승]님의 ..

안녕하세요. IdeC 연구원 조인신입니다.   사용하고 있는 서버의 OS 에 ins..

scl을 설치한 후 라이센스를 구동하려고 하는데 다음과 같은 오류가 발생합니다. 이 ..

이전 내용처럼 사용하고 있는 서버의 OS 에 필요한 RPM 이 없거나 버전이 낮아서 문..

라이센스 파일을 수정하고 lmgrd 명령어를 실행하였는데 다음과 같은 오류가 발생합니다...

라이선스 파일을 찾지 못하고 있습니다. 라이선스 파일명에는 띄워쓰기나 특수문자가 있..

안녕하세요 동아대학교 이미징 디바이스 실험실 석곧은 입니다   이전부터 synops..

안녕하세요. IdeC 연구원 조인신입니다.   synopsys 라이선스 파일에는 동일한 f..

 안녕하세요 동아대학교 이미징 디바이스 실험실 석곧은 입니다  우선 답변에..

1.  네 맞습니다.      하지만 라인이 매우 많기 때문에 지우..

동아대학교 이미징 디바이스 실험실 석곧은 입니다 답변 감사합니다. 다만 라이선스 데..

첨부하신 파일을 보면 라이선스에는 문제가 없습니다. swb 를 하면 출력되는 ..

derstading, the P+ junction touching PC is to define the PMOS diffusion, and it sho..

detailed information about ESD Rules in CSHRC folder on your cloud environment ..

degnfet/esdegpfet (diode connected) as in attached capture. Thank you.   [..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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  반도체 기업 취업전략 및 기술 특강 릴레이 세미나  반도체기술인 협..

dec.or.kr, 042-350-8538    

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deep neural network (DNN) 기술을 적용하여 놀랄 만한 다양한 성과들을 보여 주고 있으..

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반도체집적회로 10b 200MS/s 28nm CMOS Asynchronous Pipeline SAR ADC : 2015SG 10b200M..

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Automatic 128 channel de-skewing 4~9Gbps Transceiver for GDDR4 BOST (Built-Out Self..

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Verilog 초급 : 8월 7일~8일 Verilog 중급 : 8월 9일~10일 강의 진행합니다.   &..

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