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delay 값을 가지고   setup 과 hold 가 fix 된 상황입니다.   전..

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IdeC에서 제공된 컴파일러를 사용하지 않았다면 MC 는 사용하지 않았다고 체크 하시면 됩..

안녕하세요 한양대학교 정기석 교수님 연구실의 이민영 연구원입니다.   dummy 추..

우선,  outline 과 sealing 부분을 합치지 말고   icc2 에서 추출한 gd..

  패드 구성을 잘못한 경우는 예를 들어 어떤 경우인가요?   이해하지 못했..

 예를 들면 IO 필러를 넣지 않았거나 Floorplan 시 PAD 가 겹쳐서 놓이는 경우가 있..

안녕하세요,  IdeC 이종행입니다.   GND 연결을 여러 곳에서 하면 폐루프가 ..

dence] Package/Board SI simulation engineer를 위한 3D FEM Solver 수료증 발급  ..

dence] Package/Board SI simulation engineer를 위한 3D FEM Solver 수료증 발급  ..

design_scripts 를 보면, 아래와 같이 나와 있습니다. # Add net conngect definition#c..

dec에서 innovus 까지 모든 라이브러리 셋업을 진행하기에는 어려움이 있습니다.  ..

de와는 분리되어 있는 것을 확인했습니다. 그렇다면 PVDDIA로 칩 내부 Core IP에 전원을 ..

de와는 분리되어 있는 것을 확인했습니다. 그렇다면 PVDDIA로 칩 내부 Core IP에 전원을 ..

design을 진행하는 중, idec 질문/답변 개시판을 살펴보니 제공하는 Pad가 있는 것으로 ..

design을 진행하는 중, idec 질문/답변 개시판을 살펴보니 제공하는 Pad가 있는 것으로 ..

안녕하세요. 인하대학교 서영교 교수님 연구실 방재범 석사과정생입니다.SF028-2502 참가..

안녕하세요. IdeC 조인신입니다.   네, 문제없습니다.    [방재범]..

del Files을 물린 후 변수를 집어넣어서 시뮬레이션을 돌릴려고 하는데 에러가 발생을 해..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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  IdeC충북대지역센터입니다.   파운드리 공정 강좌에 많은 분들의 관심으..

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dec@cbnu.ac.kr로 문의를 주시기 바랍니다.            ..

올 2월에 진행하는 [충북대] 충북대 반도체 파운드리 소재 및 공정 강의를 신청하려..

dec에서 양질의 강의를 제공해주시고 관리해주셔서 항상 감사드립니다. 이번, "반도체 ..

[충북대 IdeC] 반도체 파운드리 소재 및 공정 증원 요청드립니다