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안녕하세요. IdeC 연구원 조인신입니다.   우선 /etc/hosts  파일에 ..

안녕하세요. IdeC 연구원 조인신입니다.   11092사진처럼 에러가 발생하는&..

     환경설정은 여러번 확인하였는데 맞게 기재하였습니다. 지금 첨..

virtuoso 를 실행하는 폴더에 display.drf 파일이 있어야 합니다. 어느 공정을 사..

device 파일을 Include 해줘야 하는데 이 과정을 했는지 확인 바랍니다. 방법은 첨부한 ..

device 파일은 include 해주었습니다 죄송하지만 아래 해당 library file을 압축하여 넣..

dec.or.kr     [이윤기 ]님의글 ====================================..

안녕하세요. IdeC 연구원 조인신입니다.   NWELL-M1 VIA 는 제공되지 않습니다. ..

device command 내 가상의 커패시터(drain과 source에) 장착하고, voltage pulse를 인가..

안녕하세요. IdeC 연구원 조인신입니다.   라이선스 데몬은 구동 중인 것으..

designer를 사용하여 회로를 구성하고 시뮬레이션을 진행하기 위해서 현재 Synopsys Bac..

defs 파일이 있어야 하며, 이 파일에 INCLUde /Customdesigner설치폴더/auxx/samples/l..

design compiler에서 필요한 verilog 파일들을 모두 load하고 compile_ultra 커맨드를 ..

design compiler에서 필요한 verilog 파일들을 모두 load하고 compile_ultra 커맨드를 ..

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안녕하세요. IdeC 연구원 조인신입니다.   PKG 정보 파일을 첨부하니 참고..

안녕하세요. IdeC 연구원 조인신입니다.   첨부한 것으로 보면 shematic 에서&nb..

 안녕하세요 부산대 반도체설계교육센터입니다. 공과대 IT분야 전공 및 관련분야..

deny 가 뜹니다. 마찬가지로 LVS 도 라이센스문제가 있는걸로 뜹니다. 관련된 자세한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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dec.or.k,  http://www.idec.or.kr 

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      IdeC 저널인 JICAS (IdeC Journal of Integrated Circuits And ..

  2018 XUP(Xilinx University Program) Professor Workshop Invitation   ..

defined by NIST - Support for private key and public key lengths of 224-bit - Syn..

dec.or.kr) –> 연구회원 신청(조교수 부터 신청 가능)      &nb..

defined by NIST - Support for private key and public key lengths of 233-bit - Syn..

dec.or.kr)  

dec.or.kr -> 마이페이지 -> EDA Tool 신청내역 -> 2018년 정기 EDA Tool ..

de -1- Maximum Operating Speed : 250 MHz 464- Slices : 15,850- DSP48s : 240 - Data ..

design, RTL to GDS (ICC II 연구개발) Applications engineer (OPC) OPC, Lithogr..

de -1- Maximum Operating Speed : 120 MHz- Slices : 260 - Low-complexity hardware ar..

dec.or.kr) 에서 지도교수 계정으로 접속 후 마이페이지-IdeC 참여내역-CDC 신청내역에서..

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