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del 에 대한 스크립트와  08_chip_finish.tcl 에서 report_timing 결과를 뽑는 부..

안녕하세요   전남대 IdeC 담당자 강병호입니다   교육을 진행하던 중에 v..

ded to the /etc/hosts file.   For example, you should have something like..

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dec.or.kr   [전현탁 ]님의글 ================================================..

안녕하세요. IdeC 연구원 조인신입니다.   해당 에러는 Ground 가 SUB..

de 탭에서 rule파일을 추가하도록 되어있는데요 PDK/LPE/Calibre_HL18G_XRC_S3.7_b 에 ..

design rule 은 지키셔야 합니다. ) 5. PDK 안의 outline.gds 파일을 stream in 하시면 ..

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dence.cshrc% virtuoso &[1] 144235% WARNING: HOST <BNEL-deLL7920> DOES NOT..

dence_Platform_Support_Plan.pdf 파일 참고 혹시 모르니 IdeC 홈페이지 -> IdeC Lib..

안녕하세요. IdeC 연구원 조인신입니다.   여러 데몬이 구동 중이어서 문제가 발..

안녕하세요. IdeC 연구원 조인신입니다.   원하는 것을 하려면 PSUB2 layer..

그럼 첫번째 질문 글에 첨부하였던 그림과 같이 PSUB2를 vss를 분리하고 싶은 블락에 그..

PSUB2 layer 가 있는 상태에서 GDS 파일을 추출하여 제출하면 됩니다.&nb..

dec.or.kr   [김진원 ]님의글 ================================================..

안녕하세요. IdeC 연구원 조인신입니다.   IC616 Base 를 설치하시는 과정 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

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안녕하세요 경북대 IdeC 입니다. 추가 신청 계획은 아직 없습니다. 일단 신청 기간이 ..

안녕하세요 경북대 IdeC 입니다. 저희는 대기자 신청을 하고 있지 않습니다. 일단 신..

 안녕하세요 전남대IdeC 입니다   대기자로 신청하시고 현재 대기자 상태이..

안녕하세요 경북대 IdeC 입니다. 증원 예정은 없습니다. 아직 수강신청 기간 중이니 ..

[Synposys] Multi-Voltage design 구현을 위한 Synopsys low power 설계 (PnR) 과정에서 ..

  안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 ..

안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 신청받았..

안녕하세요 부산대IdeC입니다. 해당강좌 20명 정원 대기자 10명까지 신청할 수 있습니..

 안녕하세요 전남대 IdeC입니다   문의주신 강좌의 경우 현재 추가 증..

dence : Virtuoso, Spectre3) Siemens EDA : Calibre, Questa (구 ModelSim) 외 &nb..

IC design Education Center(IdeC)   (채용) KAIST 반도체..