통합검색

dec에서 제공해준것인지, 아니면 hgi1113tp1.v 와 m18gm180d.v 로 추출한 것인지 문의 ..

dec에서 제공해준것인지, 아니면 hgi1113tp1.v 와 m18gm180d.v 로 추출한 것인지 문의 ..

    IdeC 선혜승입니다     이미 받을 수 있는 상황입니다 ..

안녕하세요. IdeC 연구원 조인신입니다.   Mentor 의 AMS 를 설치하고 설정만 잘..

안녕하세요. 현자사용하고 있는 OS는 CentOS 6.4 이고 AMS 버전은 17.1을 설치하였습니..

사용하고 있는 OS 가 64 bit 인지도 확인해 보시기 바랍니다. 17.1 버전은  Linux ..

 bit는 확인해보니 64bit입니다. 환경설정은 알려주신대로 설정했지만 실행이 안됩..

언급한 CentOS 6.4 64bit 버전에 동일하게 17.1 AMS 설치하고 확인해 보았으나&nbs..

안녕하세요. IdeC 연구원 조인신입니다.   사용하는 OS 에 따라 설치 및 사용 가..

  IdeC 선혜승입니다   라이센스가 잡혀 있지 않은 것 같습니다   저..

Fatal: Galaxy-Common+Galaxy-ICC is not enabled. (DCSH-1)Exit IC Compiler!  Fa..

안녕하세요. IdeC 연구원 조인신입니다.   xilinx license 관련 설치가이드는 별..

device -> CMOSInverter 예제를 참고하시기 바랍니다. 이 예제를 보면 SdeVICE 의 c..

device 관련 질문이 있어 질문 드리게 되었습니다. Sentaurus 에서 Metal과 Metal을 접..

dence tool 자체 설정을 변경해도 PDK 안에 암호화되어 있는 파일에 설정이 되어 있어 ..

안녕하세요 황경수님 전남대 IdeC 담당 강병호입니다. 글을 읽어보니 요청사항이 2가지..

안녕하세요. IdeC 연구원 조인신입니다.   첨부한 것과 같이 진행을 할 경..

dec에 가서 DRC error를 해결 할 수 있는지   발생하는 에러는 머지를 하면 해결될..

dec에가서 따로 DRC를 돌려야 한다고   저번에 답변해 주셨는데, idec에 가서 DRC..

   안녕하세요  전남대 IdeC 담당 강병호입니다.  수료증 발급에..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dec.or.kr -> 마이페이지 -> EDA Tool 신청내역 - 첨부한 2015년 EDA Tool 수..

Category Analog & Mixed Signal > Timing/Clock Circuit > PLL > (Output Freq.) Over..

2016년 5월 23일~ 5월 25일까지 있었던  [IdeC 연구원 강의]Full-Custom 설계..

             &..

des a 6-bit SAR ADC, 6-bit DPWM, analog dead-time & driver circuits, and proposed b..

dec.or.kr, 042-350-8533● 참가신청 : 바로가기(Click!!) - 신청자 : 지도교수만 가..

devices using ambient vibrational energy. To use PE energy effectively, the harvest..

dec.or.kr (접수 기간내 도착분 한함)    - ..

decision algorithm enables to alleviate the speed limitation and lower power consum..

dec.or.kr, 042-350-8533● 참가신청 : 바로가기(Click!!) - 신청자 : 지도교수만 가..

Category Analog & Mixed Signal > Power Management Circuit > DC-DC Converter > Oth..

dec.or.kr 로 신청 및 접수                &n..

der 11-Bit > (Conversion Rate) 100MSPS ~ 200MSPS description A 100MS/s 10-bi..

decription 도 강좌내용에 추가되었으면 합니다.  (VOD 서비스가 지원되었으면 합..

dec.or.kr, 042-350-8533● 참가신청 : 바로가기(Click!!) - 신청자 : 지도교수만 가..

ded with DLL. The number of stages of DLL is able to be adjusted for changing injec..

der and ΣΔ modulator noise. The output clock of this circuit is 4.5GHz and input re..

detector and FLL loop with deadzone creator. During locked state, FLL loop’s charge..

dec.or.kr/    4. 자세한 사항은 IdeC 웹페이지를 참조해주세요. ..