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   안녕하세요  전남대 IdeC 담당 강병호입니다.  수료증 발급에..

2017-08-24 ~ 2017-08-28 기간동안 전남대 IdeC 센터에서 진행된 'PSPICE를 활용한 아날..

design 할때 사용하지 않는 pin은 wiring을 해두지 않았습니다. 이런 것이 문제가 될 수 ..

design 할때 사용하지 않는 pin은 wiring을 해두지 않았습니다. 이런 것이 문제가 될 수 ..

design compiler 이후 만들어 진 netlist를 봤는데 clock period에 따라 변화가 있었습니..

dence의 config (post-simulation)을 돌리니, 최근 아래의 에러 메시지가 뜨면서 실행되..

dence의 config (post-simulation)을 돌리니, 최근 아래의 에러 메시지가 뜨면서 실행되..

  디지털 셀에는 메탈 정보가 모두 포함되어 있지 않습니다. Calibre DRC 를 확인..

그렇다면 PNR된 Digital 파트에는 analog부분의 layout을 할때 일반적으로 쓰고 있는 DRC..

 같은 DRC Rule 파일을 사용합니다.     단지 디지털 셀 안에 레..

안녕하세요. IdeC 연구원 조인신입니다.   첨부한 방법으로 진행하면 문제..

답변 감사합니다. 한 가지 더 여쭤 볼게 있는데, 혹시 이전에 제가 문의 드렸던 것처럼 ..

문의한 것 처럼 할 수 있으나 그러려면 PNR 내부의 layout 을 보고 schematic 을 만들어..

 안녕하세요. IdeC 교육담당 김영지입니다.   동영상의 질이 좋지 않거나, ..

몇 년 전 다른 제목과 다른 교수님의 IdeC 동영상 강의가 있었는데, 지금은 없습니다. ..

dence 문서 중 vivaxlug.pdf 파일이 있습니다. 이 파일의 내용은 Virtuoso Visualizatio..

안녕하세요 한양대학교 회로 및 시스템 연구실 신종윤입니다.   AMS를 하여 digit..

  IdeC 선혜승입니다     에러만 보면 판단이 잘 안 됩니다   ..

안녕하세요, 광운대 IdeC입니다.   수료증의 이름은 본인이 회원가입하실 때 작성..

  IdeC 선혜승입니다     이의숙선생님께 메일로 안내 메일을 받으셨..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

안녕하세요 부산대 반도체설계교육센터입니다 더 많은 수강기회를 드리고 싶지만 원활..

안녕하세요 경북대 IdeC 입니다. 아직 신청 기간이 많이 남아 홈페이지를 살펴봐 주시..

안녕하세요   Testable design of VLSI Semiconductor for Low Power Consumption..

안녕하세요 IdeC교육생 양동현입니다. 다름이 아니라 디지털회로설계 (RTL-to-GDSI..

   추가 신청하실 수 있도록 조치 하겠사오니  담당자 메일(senachung@..

  안녕하세요   경북대 IdeC 입니다.   아직 신청 기간이 많이 남아..

안녕하세요 경북대 IdeC 입니다. 아직 신청 기간이 많이 남아 홈페이지를 살펴봐 주시..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  현재 실습실 및 툴 수량의 제한으로 증원..

온라인 강의 정원 초과로 인하여 증원신청 드리고 싶습니다. 감사합니다.

dec@knu.ac.kr 메일로 성함과 연락처 보내주세요. 감사합니다.     [..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가합니..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가합니..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가합니..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가하며,..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가합니..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가하며,..

안녕하십니까!!! 반도체의 "공정"이란 글자만 보이면 항상 23시 50분 부터 휴대폰 및 노..