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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
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질문/답변
  제목 작성자 작성일 조회
203 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] ..

port 가 명시되어야 합니다. 그것이 아래 내용입니다. setenv LM_LICENSE_FILE 27000@..

조인신 16.07.13 1
202 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [..

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김덕기 16.07.13 3
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조인신 16.07.13 4
200 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [..

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김덕기 16.07.14 5
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조인신 16.07.15 7
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김덕기 16.07.15 5
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조인신 16.07.15 2
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김덕기 16.07.15 3
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조인신 16.07.14 6
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김덕기 16.07.14 22
193 [답변] mentor license 관련 질문드립니다.

port 와 IP 를 적어주신 후 mentor tool 을 사용하시기 바랍니다.    ..

조인신 16.07.04 15
192 [답변] mentor license 관련 질문드립니다.

port_num@IP_num:port_num@IP_num 로 정의해주면 됩니다.   2. mentor 라이선스 ..

조인신 16.07.01 16
191 [김수환] Finesim 사용관련

port@host or /dirs/licence.dat# Comment out this line to skip license setup#-------..

김현종 16.06.24 24
190 [답변] Finesim 사용관련

port@host set path = ($path $FINESIM_HOME/bin) 이렇게만 작성하면 됩니다.   ..

조인신 16.06.24 44
189 [류승탁] [magna/SK hynix 018um]PEX 관련

port들이 뽑히지 않는 현상이 있습니다. 특징으로는 해당 node들이 적게는 435um 에서 ..

진동환 16.06.21 16
188 [답변] [magna/SK hynix 018um]PEX 관련

port 가 뽑히는 것과 무관합니다. port 명이 schematic 과 layout 에서 모두 소문..

조인신 16.06.21 28
187 [답변] Window 10에서 HSPICE 사용법

port_num@라이선스데몬구동서버IP 만 해주면 됩니다.   그리고, 라이선스 ..

조인신 16.06.14 27
186 [김정석] Package DRC에러

port-Stream 에서 아이덱에서 제공해준 gds파일을 불러와서 apply(사진1)   새로..

윤정대 16.06.03 21
185 [답변] Package DRC에러

port  setup 에서 layer map file 부분에 HL35S.layerMap 파일의 경로와 파일명을 ..

조인신 16.06.03 39
184 [남상욱] cadence 의 library manager 실행 시 오류

port thumbnail MPS services Loading geView.cxt Loading menuBuilder.cxt Loading s..

구종섭 16.06.02 45
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
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권경하 24.02.13 7
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류성주 24.01.03 15
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portfolio of silicon IP—predesigned blocks of logic, memory, interfaces, anal..

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