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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
2343 [답변] Design copiler 에서 multi-clock 사용에 관한 문의

ports 4X_CLK] [get_ports 2x_clk] create_generated_clock -divide_by 4 -name 1X..

선혜승 22.04.13 37
2342 PT ECO시 Violation이 안잡히는 path에 대해서 문의드립니다.

port_inst_0__input_port/U112/Y               &nb..

김준수 22.04.12 52
2341 [답변] PT ECO시 Violation이 안잡히는 path에 대해서 문의드립니다.

port_analysis_converage 명령으로 나온 결과를 보여주신 뒤에      re..

선혜승 22.04.13 136
2340 [답변] TCAD Sentaurus SDE의 input file 생성에 관하여

port-mesh-2d: wrong argument type string 이라고 되어 있습니다. sde:export-mesh-2d ..

조인신 22.04.13 14
2339 MOSFET spice model import 방법

port하는 방법이 있는지 궁금하여 여쭤봅니다.    감사합니다.

송충석 22.04.07 18
2338 [답변] MOSFET spice model import 방법

port 를 하는 것이 아닌 시뮬레이션 시 schematic 의 netlist 에 include 또는 .LIB 으..

조인신 22.04.07 16
2337 [답변] MOSFET spice model import 방법

port 를 하는 것이 아닌 시뮬레이션 시 schematic 의 netlist 에 include 또는 .LIB 으..

송충석 22.04.07 15
2336 [답변] MOSFET spice model import 방법

port 를 하는 것이 아닌 시뮬레이션 시 schematic 의 netlist 에 include 또는 .LIB 으..

조인신 22.04.07 9
2335 [답변] MOSFET spice model import 방법

port 를 하는 것이 아닌 시뮬레이션 시 schematic 의 netlist 에 include 또는 .LIB 으..

송충석 22.04.07 41
2334 삼성 28nm 머지 LVS관련해서 문의드립니다.

port에서 error가 발생하는 것 같아 해결방안을 알려주시면 감사하겠습니다. 3. icc2에..

이석진 22.04.05 77
2333 [답변] 삼성 28nm 머지 LVS관련해서 문의드립니다.

port에서 error가 발생하는 것 같아 해결방안을 알려주시면 감사하겠습니다. 3. icc2에..

선혜승 22.04.05 45
2332 [답변] 삼성 28nm 머지 LVS관련해서 문의드립니다.

port에서 error가 발생하는 것 같아 해결방안을 알려주시면 감사하겠습니다. 3. icc2에..

이석진 22.04.05 78
2331 [답변] 삼성 28nm 머지 LVS관련해서 문의드립니다.

port에서 error가 발생하는 것 같아 해결방안을 알려주시면 감사하겠습니다. 3. icc2에..

선혜승 22.04.06 224
2330 [답변] Cadence auCdl 설정 방법 문의

port 선택 후  열리는 창의 Include File 라인에 /PAD_cdl_파일의_위치/PAD_cdl_명..

조인신 22.04.05 72
2329 [답변] Cadence hostid관련 문의

port 및 Online training course관련하여 아래의 내용을 참고 부탁드립니다. 가입을 희..

이경옥 22.03.28 52
2328 [답변] LCU 버전 문의

port 를 열어줘야 할 것입니다. 그런데 cadence 라이선스의 기본 port 는 5280 이나 실..

조인신 22.03.24 25
2327 Cadence license 관련 문의

port for assistance.   이에 대한 해결방법을 알려주시면 감사드리겠습니다! &n..

전태준 22.03.23 78
2326 [답변] Cadence license 관련 문의

port for assistance.   이에 대한 해결방법을 알려주시면 감사드리겠습니다! &n..

조인신 22.03.23 37
2325 [답변] Cadence license 관련 문의

port를 개방하여 실행하고 방화벽을 해제하고도 실행해봤더니 똑같이 실행이 안되는 상황..

전태준 22.03.23 22
2324 [답변] Cadence license 관련 문의

port를 개방하여 실행하고 방화벽을 해제하고도 실행해봤더니 똑같이 실행이 안되는 상황..

조인신 22.03.23 22
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
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구분 제목 작성자 작성일 조회
참여교수 성과 - 논문 portable Functional Brain Imaing Chip for Frequency-Domain NIRS Method

권경하 24.02.13 7
참여교수 성과 - 논문 Fully I-V-based Optoelectronic Differential Ideality Factor Method f..

배학열 24.02.08 2
참여교수 성과 - 논문 Ferroelectric nanopillar field-effect transistors: Quantum transport..

신민철 24.02.07 7
참여교수 성과 - 논문 LOG-CIM: A 116.4 TOPS/W Digital Computing-In-Memory Processor Suppor..

유회준 24.02.01 14
참여교수 성과 - 논문 A 28-nm Ternary Dual-port SRAM Cell for Area and Power Efficient On-..

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참여교수 성과 - 논문 An Efficient Systolic Array with Variable Data Precision and Dimensi..

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참여교수 성과 - 특허 단일 싱글포트램(Single-port RAM) 기반 영상 데이터 패킹 기법

단일 싱글포트램(Single-port RAM) 기반 영상 데이터 패킹 기법

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류성주 24.01.03 15
구인/구직 (채용) Synopsys Korea 인재채용

portfolio of silicon IP—predesigned blocks of logic, memory, interfaces, anal..

정재희 23.10.05 4573
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