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교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 | MWOffICE 를 이용한 설계 기초/실습 | 구재희 | 02.01.15 | 187 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 101 |
cadence 라이센스 관련 문의입니다.
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : LCU EDA Tool 버전(SCL/L.. |
구용서 | 15.12.22 | 40 |
| 100 |
[답변] cadence 라이센스 관련 문의입니다.
안녕하세요.IDEC 연구원 조인신입니다. 우선 글 작성 .. |
조인신 | 15.12.22 | 52 |
| 99 |
[김병성] astro license 관련 문의
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Astro EDA Tool 버.. |
김동균 | 15.12.15 | 55 |
| 98 |
[답변] astro license 관련 문의
안녕하세요IDEC 김연태 입니다. 아래 라이센스 변수를 추가한 뒤 다시 .. |
김연태 | 15.12.15 | 32 |
| 97 |
[답변] [답변] astro license 관련 문의
그부분은 이미 synopsys.cshrc파일로 작성이 되어 있습니다.. [김연태 .. |
김동균 | 15.12.15 | 29 |
| 96 |
[답변] [답변] [답변] astro license 관련 문의
IDEC 선혜승입니다 결론 부터 말씀드리면 문제 없습니다 첨부된 그림을 .. |
선혜승 | 15.12.17 | 63 |
| 95 |
[양영구] [삼성65nm] 서버연결
ffers: R=[8192->8192] S=[8192->8192]Mon Dec 14 17:04:49 2015 UDPv4 link local.. |
배종석 | 15.12.14 | 26 |
| 94 |
[답변] [삼성65nm] 서버연결
ffers: R=[8192->8192] S=[8192->8192]Mon Dec 14 17:04:49 2015 UDPv4 link local.. |
김연태 | 15.12.15 | 33 |
| 93 |
CSiEDA 5.4 SE 설치에 관한 질문입니다.
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : CSiEDA 5.4 SE EDA Tool .. |
김태욱 | 15.11.17 | 61 |
| 92 |
[답변] CSiEDA 5.4 SE 설치에 관한 질문입니다.
안녕하세요.IDEC 연구원 조인신입니다. 문의 글에 첨부하신 내용을 보니 ID 를 LBK0.. |
조인신 | 15.11.18 | 19 |
| 91 |
[답변] CSiEDA 5.4 SE 설치에 관한 질문입니다.
안녕하세요.IDEC 연구원 조인신입니다. 현재 라이센스 서버를 확인해보.. |
조인신 | 15.11.18 | 34 |
| 90 |
[답변] [답변] 툴이 동작하지 않아 문의 드립니다.
안녕하세요? 앞서 질문에서 말씀하신 ip에서 사용을 하였는데 동작을 하지 않습니다.. |
최정완 | 15.11.12 | 28 |
| 89 |
[답변] [답변] [답변] 툴이 동작하지 않아 문의 드립니다.
안녕하세요.IDEC 연구원 조인신입니다. 네트워크 라이센스는 해당 IP 의 .. |
조인신 | 15.11.12 | 14 |
| 88 |
[답변] S65 공정
안녕하세요.IDEC 연구원 조인신입니다.  .. |
조인신 | 15.10.15 | 18 |
| 87 |
[답변] S65 simulation
fff_tuning,cor_tuning) 세팅에 문제가 있는 것 같은데요.Model library는 세팅은 특별히.. |
조인신 | 15.09.21 | 12 |
| 86 |
[심동하] S65 simulation
fff_tuning,cor_tuning) 세팅에 문제가 있는 것 같은데요.Model library는 세팅은 특별히.. |
심동하 | 15.09.19 | 14 |
| 85 |
[답변] gds 파일 업로드 시 error
ffset 0.이런식으로 파일을 열 수 없다고 나옵니다..... |
선혜승 | 15.09.07 | 52 |
| 84 |
gds 파일 업로드 시 error
ffset 0.이런식으로 파일을 열 수 없다고 나옵니다..... |
이성수 | 15.09.05 | 29 |
| 83 |
[답변] astro 후 prime time에서 hold time violation을 못잡겠습니다....
ffer 를 삽입해야 될 것 같네요 알려드린 자료에서 ECO 부분을 참고 하시면 좋을 것.. |
선혜승 | 15.09.04 | 69 |
| 82 |
astro 후 prime time에서 hold time violation을 못잡겠습니다....
ffective for the timing arc (hgi1113tp1_wci/PHOB12) pad ...이런 warning이 수십개 발.. |
이성수 | 15.09.03 | 45 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 14 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
fftw libreadline*yum -y install xorg*font* xterm redhat-lsbyum -y install compat-op.. |
관리자 | 25.03.20 | 1851 |
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Linux OS 설치 가이드 2021 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 21.04.30 | 8238 |
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(Tool 활용법 공유) Cadence Manual - Virtuoso ADE L,XL (2020.06.24)
IC Design Education Center(IDEC) (Tool 활용법 공유) Caden.. |
석은주 | 20.06.24 | 2427 |
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Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 16.03.22 | 16796 |
| 10 |
e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도
ffects, electromigration, ESD) 키워드 : 수율 |
구재희 | 04.12.30 | 1044 |
| 9 |
e2l-디지털시스템-논리회로 설계 및 실험
ffic light controller 의 동작을 살펴본다.• 제14주State minimization, State as.. |
구재희 | 05.01.05 | 1087 |
| 8 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : 키워드 : CMOS, 차동 증폭기, 회로 해석, PSPICE |
구재희 | 05.09.07 | 1059 |
| 7 |
e2l-아날로그 회로-전자회로
fferential circuit, feedback, frequency response |
구재희 | 05.01.11 | 980 |
| 6 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항.. |
구재희 | 04.12.30 | 1090 |
| 5 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 05.09.07 | 754 |
| 4 |
e2l-접적회로-VLSI 설계
ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로.. |
구재희 | 05.01.05 | 1031 |
| 3 |
e2l-접적회로-Full-custom Digital IC 설계 과정과 검증
ff까지 전체 과정을 소개) ● Full-custom 설계를 위한 설계 환경 및 CAD tool 소개 ●.. |
구재희 | 04.12.30 | 1322 |
| 2 |
e2l-접적회로-표준 CMOS 설계 규칙과 Layout 실습
ffer 설계 ● 저전력 설계 방안 ● Design margin ● Clock skew ● Latch-up 문제 .. |
구재희 | 04.12.30 | 897 |
| 1 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 04.12.30 | 831 |
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fficiency. The converter includes a 6-bit SAR ADC, 6-bit DPWM, analog dead-time & d.. |
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