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교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 | MWOffICE 를 이용한 설계 기초/실습 | 구재희 | 02.01.15 | 187 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1761 |
[SS28-2402] ICC2 init design 질문
ffset을 주어 입력해야하는지 궁금합니다. .tdf 파일의 경우 그림과 같이 나오.. |
장민기 | 24.11.11 | 39 |
| 1760 |
[답변] [SS28-2402] ICC2 init design 질문
ffset을 주어 입력해야하는지 궁금합니다. .tdf 파일의 경우 그림과 같이 나오.. |
김연태 | 24.11.11 | 22 |
| 1759 |
[답변] [SS28-2402] ICC2 init design 질문
ffset을 주어 입력해야하는지 궁금합니다. .tdf 파일의 경우 그림과 같이 나오.. |
장민기 | 24.11.11 | 12 |
| 1758 |
[답변] [SS28-2402] ICC2 init design 질문
ffset을 주어 입력해야하는지 궁금합니다. .tdf 파일의 경우 그림과 같이 나오.. |
김연태 | 24.11.11 | 11 |
| 1757 |
[답변] [SS28-2402] ICC2 init design 질문
ffset을 주어 입력해야하는지 궁금합니다. .tdf 파일의 경우 그림과 같이 나오.. |
장민기 | 24.11.11 | 13 |
| 1756 |
[답변] [SS28-2402] ICC2 init design 질문
ffset을 주어 입력해야하는지 궁금합니다. .tdf 파일의 경우 그림과 같이 나오.. |
김연태 | 24.11.11 | 83 |
| 1755 |
[SB130-2401] DRC error 관련하여 문의드립니다.
ffGrid - 130 nm 공정의 grid는 0.005 인 것으로 알고 있는데요, POIPAD Off GRID check.. |
박찬진 | 24.11.07 | 163 |
| 1754 |
[답변] [SB130-2401] DRC error 관련하여 문의드립니다.
ffGrid - 130 nm 공정의 grid는 0.005 인 것으로 알고 있는데요, POIPAD Off GRID check.. |
이종행 | 24.11.08 | 266 |
| 1753 |
[답변] [SB130-2401] dummy protection 관련 문의
안녕하세요, 박유미님 DMMPR.x DRC ERROR는 Clear 되어야 합니다. Dummy.. |
이종행 | 24.11.08 | 43 |
| 1752 |
[답변] 삼성28nm 공정 문의
ffect 를 의미하며 시뮬레이션 시 사용하는 파라미터 값으로 1 이면 고려를 하여 시뮬레.. |
조인신 | 24.11.07 | 83 |
| 1751 |
[답변] [SB130-2401] guard ring 관련 DRC error 문의
ffusion 이 3 이하여야 한다고 하는거 같은데 어떻게 해야하는 걸까요? 말씀해주신 순서.. |
박종혁 | 24.11.06 | 35 |
| 1750 |
[답변] [SB130-2401] guard ring 관련 DRC error 문의
ffusion 이 3 이하여야 한다고 하는거 같은데 어떻게 해야하는 걸까요? 말씀해주신 순서.. |
이종행 | 24.11.06 | 35 |
| 1749 |
[답변] [SB130-2401] guard ring 관련 DRC error 문의
ffusion 이 3 이하여야 한다고 하는거 같은데 어떻게 해야하는 걸까요? 말씀해주신 순서.. |
박종혁 | 24.11.06 | 95 |
| 1748 |
Extremely slow performance in SS28 server
ffected to virtuoso opening. So please take an action immidiatly to fixed it. Than.. |
이종욱 | 24.11.05 | 22 |
| 1747 |
[답변] [SB130-2401] DRC Antenna error 문의
안녕하세요, IDEC 이종행입니다. Antenna error에 대해 본인도 현상은 이.. |
이종행 | 24.10.31 | 75 |
| 1746 |
AMS simulation, simulation 결과값 초기화 안되는 문제가 있습니다.
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Cadence virtuoso EDA Tool 버전(.. |
장준서 | 24.10.30 | 18 |
| 1745 |
[답변] AMS simulation, simulation 결과값 초기화 안되는 문제가 있습니다.
안녕하세요. IDEC 조인신입니다. 문제의 원인이 무엇인지 글만으로 파악하기는.. |
조인신 | 24.10.30 | 11 |
| 1744 |
[답변] AMS simulation, simulation 결과값 초기화 안되는 문제가 있습니다.
넵 답변 감사합니다. 장준서 드림 [조인신]님의 글 ===.. |
장준서 | 24.10.30 | 28 |
| 1743 |
Unusually slow performance on the SS28 server
ffecting Virtuoso opening, Schematic and simulation running. Details: Iss.. |
이종욱 | 24.10.28 | 45 |
| 1742 |
[답변] [SB130-2401] Full custom 설계 시 소자 및 ESD 관련 질문
안녕하세요, IDEC 이종행입니다. 질문에 댓글로 달았습니다. 감사합니.. |
이종행 | 24.10.24 | 103 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 14 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
fftw libreadline*yum -y install xorg*font* xterm redhat-lsbyum -y install compat-op.. |
관리자 | 25.03.20 | 1852 |
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Linux OS 설치 가이드 2021 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 21.04.30 | 8238 |
| 12 |
(Tool 활용법 공유) Cadence Manual - Virtuoso ADE L,XL (2020.06.24)
IC Design Education Center(IDEC) (Tool 활용법 공유) Caden.. |
석은주 | 20.06.24 | 2427 |
| 11 |
Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 16.03.22 | 16796 |
| 10 |
e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도
ffects, electromigration, ESD) 키워드 : 수율 |
구재희 | 04.12.30 | 1044 |
| 9 |
e2l-디지털시스템-논리회로 설계 및 실험
ffic light controller 의 동작을 살펴본다.• 제14주State minimization, State as.. |
구재희 | 05.01.05 | 1087 |
| 8 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : 키워드 : CMOS, 차동 증폭기, 회로 해석, PSPICE |
구재희 | 05.09.07 | 1059 |
| 7 |
e2l-아날로그 회로-전자회로
fferential circuit, feedback, frequency response |
구재희 | 05.01.11 | 980 |
| 6 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항.. |
구재희 | 04.12.30 | 1090 |
| 5 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 05.09.07 | 754 |
| 4 |
e2l-접적회로-VLSI 설계
ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로.. |
구재희 | 05.01.05 | 1031 |
| 3 |
e2l-접적회로-Full-custom Digital IC 설계 과정과 검증
ff까지 전체 과정을 소개) ● Full-custom 설계를 위한 설계 환경 및 CAD tool 소개 ●.. |
구재희 | 04.12.30 | 1322 |
| 2 |
e2l-접적회로-표준 CMOS 설계 규칙과 Layout 실습
ffer 설계 ● 저전력 설계 방안 ● Design margin ● Clock skew ● Latch-up 문제 .. |
구재희 | 04.12.30 | 897 |
| 1 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 04.12.30 | 831 |
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