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교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 | MWOffICE 를 이용한 설계 기초/실습 | 구재희 | 02.01.15 | 187 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1481 |
[SF28] Place 작업중 buffer inverter 에러
ffer inverter를 찾을 수 없다는 Error가 발생하여 관련 내용을 첨부하겠습니다. .. |
장석우 | 23.11.30 | 19 |
| 1480 |
[답변] [SF28] Place 작업중 buffer inverter 에러
ffer inverter를 찾을 수 없다는 Error가 발생하여 관련 내용을 첨부하겠습니다. .. |
김연태 | 23.11.30 | 12 |
| 1479 |
[답변] [SF28] Place 작업중 buffer inverter 에러
ffer inverter를 찾을 수 없다는 Error가 발생하여 관련 내용을 첨부하겠습니다. .. |
장석우 | 23.12.01 | 23 |
| 1478 |
[답변] [SF28] ICV 이용 문의
ff drc autofix 기능을 사용해서 DRC 갯수를 줄여보기 위함입니다. 말씀해주신 .. |
장재용 | 23.11.30 | 8 |
| 1477 |
[답변] [SF28] ICV 이용 문의
ff drc autofix 기능을 사용해서 DRC 갯수를 줄여보기 위함입니다. 말씀해주신 .. |
장재용 | 23.11.30 | 19 |
| 1476 |
SF28 DRC error 문의
ffset by >= 0.100 um from each other 감사합니다. 감동윤 드림 |
감동윤 | 23.11.30 | 22 |
| 1475 |
[답변] SF28 DRC error 문의
ffset by >= 0.100 um from each other 감사합니다. 감동윤 드림 |
김연태 | 23.11.30 | 100 |
| 1474 |
[SF28] ICV 이용 문의
ff_drc_check라는 명령어가 ICV tool과 foundry runset을 이용해서 drc check를 하고 이.. |
장재용 | 23.11.29 | 22 |
| 1473 |
[답변] [SF28] ICV 이용 문의
ff drc check 로 사용하시려면 physical 정보를 포함해야 합니다. merge 계정으로.. |
김연태 | 23.11.30 | 8 |
| 1472 |
[답변] [SF28] ICV 이용 문의
ff drc check 로 사용하시려면 physical 정보를 포함해야 합니다. merge 계정으로.. |
장재용 | 23.11.30 | 5 |
| 1471 |
[답변] [SF28] ICV 이용 문의
ff drc check 로 사용하시려면 physical 정보를 포함해야 합니다. merge 계정으로.. |
김연태 | 23.11.30 | 9 |
| 1470 |
[답변] [SF28] ICV 이용 문의
ff drc check 로 사용하시려면 physical 정보를 포함해야 합니다. merge 계정으로.. |
장재용 | 23.11.30 | 17 |
| 1469 |
[답변] FDSOI PNR 결과 merge 서버에서의 LVS 관련 질문드립니다
우선 단일 셀 1개만 가지고 테스트를 한번 해보시기 바랍니다. (Dff 등) .. |
김연태 | 23.11.30 | 13 |
| 1468 |
[답변] FDSOI PNR 결과 merge 서버에서의 LVS 관련 질문드립니다
답변 감사드립니다. 오늘 발송된 머지 가이드 첨부파일에서는 lvs를 icc2 툴에서만 진행.. |
유지민 | 23.11.30 | 11 |
| 1467 |
[답변] FDSOI PNR 결과 merge 서버에서의 LVS 관련 질문드립니다
아닙니다. 머지 전에 1차 점검을 한 것을 안내한 것으로 머지후 LVS 를 .. |
김연태 | 23.11.30 | 69 |
| 1466 |
[질문] synopsys TCAD, Kinetic Monte Carlo ReRAM
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : synopsys U-2022.12 EDA Tool 버.. |
이중호 | 23.11.28 | 32 |
| 1465 |
[답변] [질문] synopsys TCAD, Kinetic Monte Carlo ReRAM
안녕하세요 IDEC 정재희입니다. 질문에 대한 답변을 아래와 같이 전달드립.. |
정재희 | 23.12.14 | 55 |
| 1464 |
[답변] [질문] synopsys TCAD, Kinetic Monte Carlo ReRAM
안녕하십니까? IDEC 정재희입니다. 문의하신 사항은 벤더사에게 전달 후 .. |
정재희 | 23.11.28 | 54 |
| 1463 |
[SF28-2301회] 메모리 pin, CTS용 cell, DRC 문의
ffer와 inverter로만 구성을 해주면 되는지 문의드립니다. 3. Standard cell 내부에서 .. |
유병석 | 23.11.21 | 31 |
| 1462 |
[답변] [SF28-2301회] 메모리 pin, CTS용 cell, DRC 문의
ffer와 inverter로만 구성을 해주면 되는지 문의드립니다. 3. Standard cell 내부에서 .. |
김연태 | 23.11.22 | 16 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 14 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
fftw libreadline*yum -y install xorg*font* xterm redhat-lsbyum -y install compat-op.. |
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Linux OS 설치 가이드 2021 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
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(Tool 활용법 공유) Cadence Manual - Virtuoso ADE L,XL (2020.06.24)
IC Design Education Center(IDEC) (Tool 활용법 공유) Caden.. |
석은주 | 20.06.24 | 2427 |
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Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 16.03.22 | 16796 |
| 10 |
e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도
ffects, electromigration, ESD) 키워드 : 수율 |
구재희 | 04.12.30 | 1044 |
| 9 |
e2l-디지털시스템-논리회로 설계 및 실험
ffic light controller 의 동작을 살펴본다.• 제14주State minimization, State as.. |
구재희 | 05.01.05 | 1087 |
| 8 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : 키워드 : CMOS, 차동 증폭기, 회로 해석, PSPICE |
구재희 | 05.09.07 | 1059 |
| 7 |
e2l-아날로그 회로-전자회로
fferential circuit, feedback, frequency response |
구재희 | 05.01.11 | 980 |
| 6 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항.. |
구재희 | 04.12.30 | 1090 |
| 5 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 05.09.07 | 754 |
| 4 |
e2l-접적회로-VLSI 설계
ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로.. |
구재희 | 05.01.05 | 1031 |
| 3 |
e2l-접적회로-Full-custom Digital IC 설계 과정과 검증
ff까지 전체 과정을 소개) ● Full-custom 설계를 위한 설계 환경 및 CAD tool 소개 ●.. |
구재희 | 04.12.30 | 1322 |
| 2 |
e2l-접적회로-표준 CMOS 설계 규칙과 Layout 실습
ffer 설계 ● 저전력 설계 방안 ● Design margin ● Clock skew ● Latch-up 문제 .. |
구재희 | 04.12.30 | 897 |
| 1 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 04.12.30 | 831 |
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PRESENT-80 Encryption
fficiency has a block size of 64-bits and a key size of 80-bits or 128-bits. The PR.. |
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Multi-phase Fractional-ratio Frequency Multiplying Delay-Locked Loop
ffective peak-to-peak jitter of 20ps at 1GHz (N=4, M=2) and occupies an active area.. |
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Canny edge detector using 3-line buffer
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