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교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 | MWOffICE 를 이용한 설계 기초/실습 | 구재희 | 02.01.15 | 187 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1307 |
Synopsys Sentaurus 문의
1. 현재 3D 구조의 MOS Varactor(MOS Cap)에 대해 AC 시뮬레이션을 진행하고 있습니다. .. |
황보석 | 23.04.20 | 32 |
| 1306 |
[답변] Synopsys Sentaurus 문의
황보석님 안녕하세요? IDEC 이경옥입니다. 해당 문의사항은 Synopsys사 측으로 .. |
이경옥 | 23.04.21 | 19 |
| 1305 |
TCAD quantum confinement 문의
ffect 차이를 비교하려 하였는데 구현이 되지 않아 문의드립니다. (정확히는 ra.. |
박익수 | 23.04.18 | 29 |
| 1304 |
[답변] TCAD quantum confinement 문의
ffect 차이를 비교하려 하였는데 구현이 되지 않아 문의드립니다. (정확히는 ra.. |
이경옥 | 23.04.18 | 31 |
| 1303 |
[답변] TCAD Sentaurus sprocess, sdevice 오류
ffuse gas 지정 N2와 N2O로 diffuse를 하고 싶은데 O2 혹은 빈칸이 아니면 fail이 떠서 .. |
이경옥 | 23.04.17 | 50 |
| 1302 |
I/O 아날로그 Cell관련 문의드립니다.
안녕하세요, 울산과학기술원 이규호 교수님 연구실의 정주은입니다. PANALOG p.. |
정주은 | 23.04.11 | 38 |
| 1301 |
[답변] I/O 아날로그 Cell관련 문의드립니다.
IDEC 선혜승입니다 말씀하신 것 모두 맞습니다  .. |
선혜승 | 23.04.13 | 85 |
| 1300 |
PAD 포함 LVS 관련 질문 문의
안녕하세요 DGIST 김가인 교수님 연구실 공선호학생입니다. io cell, power cell에 대.. |
공선호 | 23.04.10 | 96 |
| 1299 |
[답변] PAD 포함 LVS 관련 질문 문의
IDEC 선혜승입니다 cdl 파일이 있어야만 LVS 가 가능합니다 관련 파일은.. |
선혜승 | 23.04.10 | 57 |
| 1298 |
[답변] PAD 포함 LVS 관련 질문 문의
답변 감사드립니다. 만일 .cdl 파일 spicein 할 때 device map부분을 제가 따로.. |
공선호 | 23.04.10 | 29 |
| 1297 |
[답변] PAD 포함 LVS 관련 질문 문의
IDEC 선혜승입니다 device map은 필요가 없었습니다 lvs 자료 .. |
선혜승 | 23.04.10 | 32 |
| 1296 |
[답변] PAD 포함 LVS 관련 질문 문의
답변 감사합니다. io_gppr_cmos28lpp_t18_mv11_mv18_tl25_rvt_dr.. |
공선호 | 23.04.10 | 22 |
| 1295 |
[답변] PAD 포함 LVS 관련 질문 문의
IDEC 선혜승입니다 관점이나 시각이 저와 다르신 것 같네.. |
선혜승 | 23.04.10 | 146 |
| 1294 |
PAD 포함 LVS 관련 질문 문의
ff.경찰 유치장에 몇 시간 넣어 두면 그가 진정될 거요.","","VLIVE 자막","Show my cell.. |
공선호 | 23.04.04 | 83 |
| 1293 |
[답변] PAD 포함 LVS 관련 질문 문의
ff.경찰 유치장에 몇 시간 넣어 두면 그가 진정될 거요.","","VLIVE 자막","Show my cell.. |
선혜승 | 23.04.05 | 46 |
| 1292 |
[답변] PAD 포함 LVS 관련 질문 문의
답변 진심으로 감사드립니다. 첨부해주신 ppt내용처럼 io, power cell을 black bo.. |
공선호 | 23.04.06 | 24 |
| 1291 |
[답변] PAD 포함 LVS 관련 질문 문의
IDEC 선혜승입니다 그 내용도 자료안에 들어 있습니다 .. |
선혜승 | 23.04.10 | 100 |
| 1290 |
SS28 I/O cell 및 PAD cell 관련 문의 드립니다.
안녕하세요. 카이스트 권경하 교수님 연구실 박사과정 이원빈입니다. SS28 공정 PAD 및.. |
이원빈 | 23.04.03 | 63 |
| 1289 |
[답변] SS28 I/O cell 및 PAD cell 관련 문의 드립니다.
IDEC 선혜승입니다 PAVDD PANALOG PANALOG PAN.. |
선혜승 | 23.04.04 | 41 |
| 1288 |
[답변] SS28 I/O cell 및 PAD cell 관련 문의 드립니다.
답변 주셔서 정말 감사드립니다. [선혜승]님의 글 =============.. |
이원빈 | 23.04.04 | 122 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 14 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
fftw libreadline*yum -y install xorg*font* xterm redhat-lsbyum -y install compat-op.. |
관리자 | 25.03.20 | 1856 |
| 13 |
Linux OS 설치 가이드 2021 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 21.04.30 | 8242 |
| 12 |
(Tool 활용법 공유) Cadence Manual - Virtuoso ADE L,XL (2020.06.24)
IC Design Education Center(IDEC) (Tool 활용법 공유) Caden.. |
석은주 | 20.06.24 | 2427 |
| 11 |
Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 16.03.22 | 16796 |
| 10 |
e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도
ffects, electromigration, ESD) 키워드 : 수율 |
구재희 | 04.12.30 | 1044 |
| 9 |
e2l-디지털시스템-논리회로 설계 및 실험
ffic light controller 의 동작을 살펴본다.• 제14주State minimization, State as.. |
구재희 | 05.01.05 | 1087 |
| 8 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : 키워드 : CMOS, 차동 증폭기, 회로 해석, PSPICE |
구재희 | 05.09.07 | 1059 |
| 7 |
e2l-아날로그 회로-전자회로
fferential circuit, feedback, frequency response |
구재희 | 05.01.11 | 980 |
| 6 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항.. |
구재희 | 04.12.30 | 1090 |
| 5 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 05.09.07 | 754 |
| 4 |
e2l-접적회로-VLSI 설계
ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로.. |
구재희 | 05.01.05 | 1031 |
| 3 |
e2l-접적회로-Full-custom Digital IC 설계 과정과 검증
ff까지 전체 과정을 소개) ● Full-custom 설계를 위한 설계 환경 및 CAD tool 소개 ●.. |
구재희 | 04.12.30 | 1322 |
| 2 |
e2l-접적회로-표준 CMOS 설계 규칙과 Layout 실습
ffer 설계 ● 저전력 설계 방안 ● Design margin ● Clock skew ● Latch-up 문제 .. |
구재희 | 04.12.30 | 897 |
| 1 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 04.12.30 | 831 |
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ffect(DIBL, Vth Roll off 등)를 관측하는 주제로 수업을 희망합니다 |
이동원 | 25.03.18 | 4948 |


