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  제목 강사정보 등록일
57 [IDEC 제작강좌] Timing Sign off를 위한 Star-RC/PrimeTime사용법 박규란/석사과정/한양대학교 2024.11.15
56 [IDEC 제작강좌] Innovus를 이용한 Place and Route 박규란/석사과정/한양대학교 2024.11.15
55 (2024) 반도체 소자 이윤종 교수(KAIST) 2024.05.07
54 (2023) XMODEL을 활용한 고속인터페이스 모델링 및 시뮬레이션 김재하 교수(서울대) 2023.03.27
53 신호 및 전력 무결성 (Signal_Power Integrity)를 고려한 Package, PCB 및 Intercon.. 김영우/교수/세종대 2023.03.17
52 Low-Dropout (LDO) Regulator 회로설계 김현식/교수/KAIST 2023.03.17
51 아날로그 증폭기의 동적 오프셋 제거 기법 및 실습 고형호/교수/충남대학교 2023.01.06
50 차세대 IoT 시스템 통신을 위한 5G sub 6Ghz 및 mmWave용 PLL 설계 유상선 교수 2020.12.03
49 최신 저잡음 연산증폭기 설계기술 및 실습 고형호/교수/충남대학교 2020.09.21
48 파워반도체 소자 핵심이론 강혜민/박사/Cambridge University 2019.12.19
47 DC-DC Converter 설계 노정진/교수/한양대 2019.10.25
46 저전력 IoT용 센서 신호 처리 회로 고형호/교수/충남대학교 2019.09.25
45 Deep Learning: TensorFlow, Caffe, Darknet and Tiny-DNN 기안도/대표이사/퓨쳐디자인시스템 2019.02.21
44 (S-MOOC) 반도체소자 신뢰성 김성준/조교수/충북대학교 2019.01.08
43 아날로그 집적회로 설계 박영철/교수/한국외국어대학교 2018.10.30
42 Verilog HDL 이론 및 응용 이찬호/교수/숭실대학교 2018.10.30
41 구글 텐서플로우로 배우는 필수 딥러닝 알고리즘 임성규 Professor Georgia Institute of Technology 2018.10.01
40 Arduino 프로그래밍 및 하드웨어 기초 권재원 개발팀장 (주)민트세이지 2018.09.18
39 Blue Pearl Software Seminar 2018.09.05
38 [2018-IDEC 연구원 교육] 칩 테스트 교육 선혜승 연구원(IDEC) 2018.08.17
37 (2018)Xilinx ISE를 활용한 FPGA 설계 실습 김민석 책임 (주)리버트론 2018.05.28
36 OpenCL: Machine Learning과 Deep Learning을 위한 FPGA 활용 하드웨어 가속 기안도 대표이사 ((주)퓨쳐디자인시스템) 2018.04.05
35 Arduino 프로그래밍 및 하드웨어 기초 권재원 개발팀장 (주)민트세이지 2018.03.08
34 Designing with Quartus II Software: Basic Course 이재철 부장 (AXIOS) 2018.03.06
33 (2018)[IDEC 연구원 교육] Full-Custom 설계 Flow 교육 조인신/연구원/IDEC 2018.03.05
32 FPGA-based Hardware-Acceleration for Machine-Learning/Deep-Learning 기안도 박사(퓨쳐디자인시스템) 2017.09.11
31 [IDEC 연구원 교육]리눅스 기초 및 설계환경 구축 자동화 문관식 연구원(IDEC) 2017.05.11
30 AMIQ사 DVT(Design Verification Tool) Feature Training 김천성 대리(Incusolution) 2017.04.25
29 Vivado를 활용한 Xilinx FPGA 설계 실습 김민석 팀장(리버트론) 2017.04.24
28 FPGA를 이용한 디지털 신호처리용 SoC 설계 박성정 교수(건국대) 2017.02.28
27 오픈소스 HW 플랫폼 라즈베리파이 이용진 강사(엣지아이랩) 2017.02.17
26 자율주행차량을 위한 V2X통신 및 주행환경 인지시스템 한동석 교수 경북대학교 2017.02.08
25 (2017)[IDEC 연구원 교육] IDEC MPW 설계를 위한 교육 선혜승/연구원/IDEC 2017.01.23
24 (2017)[IDEC 연구원 교육] Full-Custom 설계 Flow 교육 조인신/연구원/IDEC 2017.01.23
23 센싱네트워크 기반 사물인터넷 설계 실습과정 김봉조/강사/(주)휴인스 2017.01.23
22 아두이노 첫걸음 윤필립 대표(주식회사 촉) 2017.01.10
21 Xilinx ISE 기반의 FPGA 동작 실습 김민석 팀장 리버트론 2016.12.16
20 Mobile transceiver RFIC 설계 문현원 교수 대구대학교 2016.12.16
19 고성능 TI SAR ADC설계를 위한 이론 및 실습 홍혁기 박사(전자정보연구소) 2016.07.27
18 (2016)[IDEC 연구원 강의]Full-Custom 설계 Flow 교육 조인신 연구원(IDEC) 2016.05.30
17 (2016)[IDEC 연구원 교육]IDEC MPW 설계를 위한 교육 선혜승 연구원(IDEC) 2016.04.06
16 [무료세미나]Fallacies of Computational Analog 송방섭 교수(U.S San Diego) 2016.03.25
15 아날로그 IC 설계 및 Layout 강좌 변영재 교수(UNIST) 2016.03.14
14 (2015) 무선전력 전송용 송수신 시스템 및 회로 설계 이강윤 교수(성균관대) 2015.11.23
13 (2014) ESD 보호회로 기술 구용서 교수 (단국대학교) 2015.11.23
12 (2014) CMOS 아날로그 집적회로 실무를 위한 이론 및 실습 Ⅱ 부영건 책임연구(Hivics) 2015.11.23
11 (2014) CMOS 아날로그 집적회로 실무를 위한 이론 및 실습 I 부영건 책임연구(Hivics) 2015.11.23
10 (2015) SoC 설계 기초 및 저전력 설계 기법 김영민 조교수(광운대학교) 2015.11.23
9 디지털 신호처리를 위한 고성능 SoC설계 박성정 교수 건국대학교 2015.11.10
8 리눅스 개발 환경 이해 송상우/대표/크리시스 2015.10.29
7 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
6 (2015)[IDEC 연구원 교육]IDEC MPW 설계를 위한 교육 선혜승 연구원(IDEC) 2015.10.02
5 아나로그 IC 설계 변영재 교수(울산과학기술대학교) 2015.03.17
4 (2015)[IDEC 연구원 강의] Full-Custom 설계 Flow 교육 조인신 연구원(IDEC) 2015.01.28
3 [무료세미나]How analog has been evolved_송방섭 교수(U. C. San Diego) 송방섭 교수(U. C. San Diego) 2014.10.31
2 [IDEC 연구원 강의] Full-Custom 설계 Flow 교육 조인신 연구원(IDEC) 2014.01.23
1 (2013) [IDEC 연구원 교육]IDEC MPW 설계를 위한 교육 선혜승 연구원(IDEC) 2013.10.24
교육자료
  제목 작성자 작성일 조회
1 MWOffICE 를 이용한 설계 기초/실습 구재희 02.01.15 187
질문/답변
  제목 작성자 작성일 조회
261 [답변] [답변] [답변] [답변] [답변] synopsys 사 인증이 아이피 주소가 바뀌면 안..

fferent license file from the one you expect. 1:40:26 (lmgrd) Check to make sure th..

선혜승 17.10.17 12
260 [답변] [답변] [답변] [답변] [답변] [답변] synopsys 사 인증이 아이피 주소가 바..

fferent license file from the one you expect. 1:40:26 (lmgrd) Check to make sure th..

김진우 17.10.17 22
259 [답변] ICCOMPILER 관련 질문드립니다

ffer를 위해 만든 인버터 inv1 inv4 inv8 inv 20이 자꾸 optimization이 되어 사라집니다..

김연태 17.09.20 7
258 ICCOMPILER 관련 질문드립니다

ffer를 위해 만든 인버터 inv1 inv4 inv8 inv 20이 자꾸 optimization이 되어 사라집니다..

신종윤 17.09.20 10
257 [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

조인신 17.08.25 9
256 [답변] [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

신종윤 17.08.25 4
255 [답변] [답변] [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

조인신 17.08.25 6
254 [답변] [답변] [답변] [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

신종윤 17.08.25 5
253 [답변] [답변] [답변] [답변] [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

조인신 17.08.25 7
252 [답변] [답변] [답변] [답변] [답변] [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

신종윤 17.08.25 3
251 [답변] [답변] [답변] [답변] [답변] [답변] [답변] Connect Rules관련 질문드립니다.

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

조인신 17.08.25 7
250 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] Connect Rules관련 질문..

ffirma_ams/etc/connect_lib/cds.lib 라인이 있습니다. 위 라인이 있어야 Connect Rule..

신종윤 17.08.25 18
249 [답변] DC,FORMLAITY 결과 질문.

    IDEC 선혜승입니다   우선 FORMALITY 는 합성 전후의 결과만 서..

선혜승 17.08.09 52
248 DC,FORMLAITY 결과 질문.

DC 결과 후 SVF FILE을 LOAD 후에 FORMALITY를 확인 했습니다. CLOCKNET은 단순히 어떤 C..

황승준 17.08.09 26
247 [답변] [답변] [답변] [답변] [답변] [답변] Design_Compiler Clock delay관련 질문..

ffer가 달리거나  wire가 달라지거나 하는 방식으로 layout상에서 변화가 일어나는 ..

신종윤 17.08.08 6
246 [답변] [답변] [답변] [답변] [답변] [답변] [답변] Design_Compiler Clock delay관..

ffer가 달리거나  wire가 달라지거나 하는 방식으로 layout상에서 변화가 일어나는 ..

선혜승 17.08.08 42
245 [답변] Hspice monte carlo 질문드립니다.

안녕하세요. IDEC 연구원 조인신입니다.   문의하신 것과 같은 현상에 대해 IDEC..

조인신 17.08.02 20
244 [정하연] Hspice monte carlo 질문드립니다.

안녕하세요 연구원님 . 고려대학교 석사과정 이강훈입니다. Hspice monte carlo simulat..

이강훈 17.08.01 18
243 [답변] Cadence OA_HOME 문제

fferent size in shared object, consider re-linkingSegmentation fault/home/c3kc/ckct..

조인신 17.07.31 53
242 [답변] Cadence OA_HOME 문제

fferent size in shared object, consider re-linkingSegmentation fault/home/c3kc/ckct..

선혜승 17.07.28 33
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12 (Tool 활용법 공유) Cadence Manual - Virtuoso ADE L,XL (2020.06.24)

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11 Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)

fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com..

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10 e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도

ffects, electromigration, ESD) 키워드 : 수율

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8 e2l-아날로그 회로-Differential Amplifier

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7 e2l-아날로그 회로-전자회로

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구재희 05.01.11 980
6 e2l-아날로그 회로-Differential Amplifier

fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항..

구재희 04.12.30 1090
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ffect, Timing verification, Power integrity, Signal integrity

구재희 05.09.07 754
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ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로..

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구재희 04.12.30 897
1 e2l-접적회로-CAD algorithms: design verification of VLSI systems

ffect, Timing verification, Power integrity, Signal integrity

구재희 04.12.30 831
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