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교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 | MWOffICE 를 이용한 설계 기초/실습 | 구재희 | 02.01.15 | 187 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 61 |
[답변] 마그나칩/하이닉스 0.18 공정관련하여 문의 드립니다
dummy를 자동으로 적용하고자 하는 영역은 그냥 빈 공간으로 DB제출해주시면 됩니.. |
유은광 | 15.05.06 | 97 |
| 60 |
[윤준보] MyCADpro 서버 라이센스 설치 관련
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : seloco사 MyCAD Pro EDA .. |
윤준보 | 15.04.30 | 64 |
| 59 |
[답변] MyCADpro 서버 라이센스 설치 관련
안녕하세요 문의 하신 내용에 회신 드립니다. 설치 방법에 문제가 있는 것이 .. |
김창수 | 15.04.30 | 80 |
| 58 |
[김철우교수님] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Calibre EDA Tool 버전(S.. |
송재근 | 15.04.25 | 243 |
| 57 |
[답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. MS 공정의 경우 .. |
조인신 | 15.04.25 | 117 |
| 56 |
[답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
예 빠른 답변 감사합니다. 그 문제는 해결 되었습니다.추가적으로 질문이 있습니다.. |
송재근 | 15.04.29 | 44 |
| 55 |
[답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. calibre pex 후 .. |
조인신 | 15.04.30 | 42 |
| 54 |
[답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
예 친절한 답변 감사합니다.1. Full_custom 설계 flow 교육 자료를 참고하던 중 문.. |
송재근 | 15.04.30 | 32 |
| 53 |
[답변] [답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. 1. calibre.. |
조인신 | 15.04.30 | 25 |
| 52 |
[답변] [답변] [답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18..
예 답변 감사합니다.1.의 경우 schematic과 layout이 있는 cell에서 생성을 하긴 .. |
송재근 | 15.04.30 | 33 |
| 51 |
[답변] [답변] [답변] [답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAG..
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. 기존의 caliview.. |
조인신 | 15.04.30 | 234 |
| 50 |
[답변] [답변] 마그나칩/하이닉스 0.18 공정관련하여 문의 드립니다.
안녕하세요 답변 주신 내용을 바탕으로 virtuoso의 경우 IC5141_Hotfix에 있는&nbs.. |
김삼기 | 15.03.11 | 29 |
| 49 |
[답변] [답변] [답변] 마그나칩/하이닉스 0.18 공정관련하여 문의 드립니다.
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. 1. spectre 버전.. |
조인신 | 15.03.12 | 35 |
| 48 |
[답변] [답변] [답변] [답변] [답변] Cadence의 HSPICED 아날로그환경 사용에 관해 ..
ffset voltage 입니다. 감사합니다. [송한정 ]님의글 =================.. |
조인신 | 15.03.09 | 11 |
| 47 |
[답변] [답변] [답변] [답변] [답변] [답변] Cadence의 HSPICED 아날로그환경 사용..
ffset voltage 입니다. 감사합니다. [송한정 ]님의글 ===========.. |
송한정 | 15.03.09 | 26 |
| 46 |
[답변] Mentor사의 Calibre Demon 관련
fficiently : //ERROR : Calibre - InteractiveCalibre를 낮은 버전을 구동시킬 경우 위.. |
조인신 | 14.12.12 | 38 |
| 45 |
[질문] [답변] Mentor사의 Calibre Demon 관련
fficiently : //ERROR : Calibre - InteractiveCalibre를 낮은 버전을 구동시킬 경우 위.. |
조영세 | 14.12.12 | 22 |
| 44 |
[답변] [질문] [답변] Mentor사의 Calibre Demon 관련
fficiently : //ERROR : Calibre - InteractiveCalibre를 낮은 버전을 구동시킬 경우 위.. |
조인신 | 14.12.12 | 41 |
| 43 |
[이승훈] Mentor사의 Calibre Demon 관련
fficiently : //ERROR : Calibre - InteractiveCalibre를 낮은 버전을 구동시킬 경우 위.. |
조영세 | 14.12.10 | 57 |
| 42 |
[답변] [TOOL설치] IC5141USR6 문의
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. IC5141 Hot.. |
조인신 | 14.12.05 | 101 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 14 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
fftw libreadline*yum -y install xorg*font* xterm redhat-lsbyum -y install compat-op.. |
관리자 | 25.03.20 | 1851 |
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fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 21.04.30 | 8238 |
| 12 |
(Tool 활용법 공유) Cadence Manual - Virtuoso ADE L,XL (2020.06.24)
IC Design Education Center(IDEC) (Tool 활용법 공유) Caden.. |
석은주 | 20.06.24 | 2427 |
| 11 |
Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
관리자 | 16.03.22 | 16796 |
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e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도
ffects, electromigration, ESD) 키워드 : 수율 |
구재희 | 04.12.30 | 1044 |
| 9 |
e2l-디지털시스템-논리회로 설계 및 실험
ffic light controller 의 동작을 살펴본다.• 제14주State minimization, State as.. |
구재희 | 05.01.05 | 1087 |
| 8 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : 키워드 : CMOS, 차동 증폭기, 회로 해석, PSPICE |
구재희 | 05.09.07 | 1059 |
| 7 |
e2l-아날로그 회로-전자회로
fferential circuit, feedback, frequency response |
구재희 | 05.01.11 | 980 |
| 6 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항.. |
구재희 | 04.12.30 | 1090 |
| 5 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 05.09.07 | 754 |
| 4 |
e2l-접적회로-VLSI 설계
ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로.. |
구재희 | 05.01.05 | 1031 |
| 3 |
e2l-접적회로-Full-custom Digital IC 설계 과정과 검증
ff까지 전체 과정을 소개) ● Full-custom 설계를 위한 설계 환경 및 CAD tool 소개 ●.. |
구재희 | 04.12.30 | 1322 |
| 2 |
e2l-접적회로-표준 CMOS 설계 규칙과 Layout 실습
ffer 설계 ● 저전력 설계 방안 ● Design margin ● Clock skew ● Latch-up 문제 .. |
구재희 | 04.12.30 | 897 |
| 1 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 04.12.30 | 831 |
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