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교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 | MWOffICE 를 이용한 설계 기초/실습 | 구재희 | 02.01.15 | 187 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1467 |
[답변] FDSOI PNR 결과 merge 서버에서의 LVS 관련 질문드립니다
아닙니다. 머지 전에 1차 점검을 한 것을 안내한 것으로 머지후 LVS 를 .. |
김연태 | 23.11.30 | 69 |
| 1466 |
[질문] synopsys TCAD, Kinetic Monte Carlo ReRAM
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : synopsys U-2022.12 EDA Tool 버.. |
이중호 | 23.11.28 | 32 |
| 1465 |
[답변] [질문] synopsys TCAD, Kinetic Monte Carlo ReRAM
안녕하세요 IDEC 정재희입니다. 질문에 대한 답변을 아래와 같이 전달드립.. |
정재희 | 23.12.14 | 55 |
| 1464 |
[답변] [질문] synopsys TCAD, Kinetic Monte Carlo ReRAM
안녕하십니까? IDEC 정재희입니다. 문의하신 사항은 벤더사에게 전달 후 .. |
정재희 | 23.11.28 | 54 |
| 1463 |
[SF28-2301회] 메모리 pin, CTS용 cell, DRC 문의
ffer와 inverter로만 구성을 해주면 되는지 문의드립니다. 3. Standard cell 내부에서 .. |
유병석 | 23.11.21 | 31 |
| 1462 |
[답변] [SF28-2301회] 메모리 pin, CTS용 cell, DRC 문의
ffer와 inverter로만 구성을 해주면 되는지 문의드립니다. 3. Standard cell 내부에서 .. |
김연태 | 23.11.22 | 16 |
| 1461 |
[답변] [SF28-2301회] 메모리 pin, CTS용 cell, DRC 문의
ffer와 inverter로만 구성을 해주면 되는지 문의드립니다. 3. Standard cell 내부에서 .. |
김연태 | 23.11.22 | 76 |
| 1460 |
[답변] hspice level 62 tft문의
ff 영역 쪽에서의 current가 ids 식에 관련 상수를 낮춰 낮추는 것은 제한이 있으나 off.. |
김주석 | 23.11.24 | 6 |
| 1459 |
[답변] hspice level 62 tft문의
ff 영역 쪽에서의 current가 ids 식에 관련 상수를 낮춰 낮추는 것은 제한이 있으나 off.. |
조인신 | 23.11.24 | 5 |
| 1458 |
[답변] hspice level 62 tft문의
ff 영역 쪽에서의 current가 ids 식에 관련 상수를 낮춰 낮추는 것은 제한이 있으나 off.. |
김주석 | 23.11.27 | 4 |
| 1457 |
[답변] hspice level 62 tft문의
ff 영역 쪽에서의 current가 ids 식에 관련 상수를 낮춰 낮추는 것은 제한이 있으나 off.. |
조인신 | 23.11.27 | 14 |
| 1456 |
[답변] dw_foundation.sldb를 자동으로 불러오지 않도록 하는 compile_ultra 옵션 ..
ffort_scriptLoading db file '/tools/synopsys/dc/syn/P-2019.03/libraries/syn/dw_foun.. |
조현준 | 23.11.22 | 18 |
| 1455 |
XMODEL 사용 관련 문의 드립니다.
ffw.so가 존재하는 경로는 첨부해드린 두번째 사진과 같습니다. 이것저것 환경변수로 잡.. |
윤리나 | 23.11.20 | 42 |
| 1454 |
[답변] XMODEL 사용 관련 문의 드립니다.
ffw.so가 존재하는 경로는 첨부해드린 두번째 사진과 같습니다. 이것저것 환경변수로 잡.. |
정재희 | 23.11.21 | 24 |
| 1453 |
[답변] XMODEL 사용 관련 문의 드립니다.
ffw.so의 위치를 아래와 같이 $XMODEL_FSDBWR_PATH 환경변수로 지정해 주시면 됩니다.사.. |
박재민 | 23.11.21 | 55 |
| 1452 |
Cadence 설치 오류
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
김진훈 | 23.11.20 | 73 |
| 1451 |
[답변] Cadence 설치 오류
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
조인신 | 23.11.20 | 34 |
| 1450 |
[답변] Cadence 설치 오류
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
김진훈 | 23.11.20 | 20 |
| 1449 |
[답변] Cadence 설치 오류
fftw libreadline* libreadline*.i686 openmotif* openmotif*.i686 compat-readline* com.. |
조인신 | 23.11.20 | 96 |
| 1448 |
Dual Port SRAM 합성 시 constraint 작성 문의
ff_corner 의 constraint 와 dual_port_sram 의 source 코드 함께 첨부합니다. |
예창민 | 23.11.19 | 39 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
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Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
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석은주 | 20.06.24 | 2427 |
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Linux OS 설치 가이드 2016 (EDA Tool 사용을 위한)
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e2l-반도체공학-집적회로 설계 기술: 수율과 신뢰도
ffects, electromigration, ESD) 키워드 : 수율 |
구재희 | 04.12.30 | 1044 |
| 9 |
e2l-디지털시스템-논리회로 설계 및 실험
ffic light controller 의 동작을 살펴본다.• 제14주State minimization, State as.. |
구재희 | 05.01.05 | 1087 |
| 8 |
e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : 키워드 : CMOS, 차동 증폭기, 회로 해석, PSPICE |
구재희 | 05.09.07 | 1059 |
| 7 |
e2l-아날로그 회로-전자회로
fferential circuit, feedback, frequency response |
구재희 | 05.01.11 | 980 |
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e2l-아날로그 회로-Differential Amplifier
fferential Amplifier 개요 : ● CMOS 차동 증폭기 회로의 기능과 발전 과정 ● 저항.. |
구재희 | 04.12.30 | 1090 |
| 5 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 05.09.07 | 754 |
| 4 |
e2l-접적회로-VLSI 설계
ff할 수 있는지의 결정과정을 다루고자 한다. 키워드 : VLSI, 디지털시스템, 집적회로.. |
구재희 | 05.01.05 | 1031 |
| 3 |
e2l-접적회로-Full-custom Digital IC 설계 과정과 검증
ff까지 전체 과정을 소개) ● Full-custom 설계를 위한 설계 환경 및 CAD tool 소개 ●.. |
구재희 | 04.12.30 | 1322 |
| 2 |
e2l-접적회로-표준 CMOS 설계 규칙과 Layout 실습
ffer 설계 ● 저전력 설계 방안 ● Design margin ● Clock skew ● Latch-up 문제 .. |
구재희 | 04.12.30 | 897 |
| 1 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
ffect, Timing verification, Power integrity, Signal integrity |
구재희 | 04.12.30 | 831 |
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