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"한국 반도체산업의 경쟁력"

IDEC에서 설계인력양성의 발판을 마련하겠습니다.

강의제목 Vivado를 활용한 Xilinx FPGA 설계 실습
구분 본센터 / 설계강좌 / 초급/중급 / 이론+실습
강의시간 8.5시간 열람기간 12일
이용료(일반) 25,500원 이용료(학생) 17,000원

♦ 시스템 장애로 인해 화면의 색이 약간 노란 점 양해를 부탁드립니다. 반드시 sample 강좌 확인 후 수강을 바랍니다.

♦ 실습이 포함된 오프라인 강좌를 녹화한 동영상이며, 이론수업 위주로 동영상이 편집되어 있습니다.

 

[강좌 개요]

Xilinx Vivado SW 이해를 기반으로 프로젝트 진행 및 7-Series FPGA의 Architecture 이해를 통해 실습을 하며, HDL 설계 실습을 통한 로직 설계 기반으로 디자인을 FPGA에 다운로드 하여 로직 검증 및 디버깅을 한다.

 

[사전지식]

HDL(VHDL, Verilog) 기본 지식

강의시간 강사(이름/직급/소속) 내용
2h 4m 김민석 팀장(리버트론) 1일차 오후
4h 12m 김민석 팀장(리버트론) 2일차 전체
2h 16m 김민석 팀장(리버트론) 3일차 전체
10m 김민석 팀장(리버트론) sample
담당자 연락처
강의자료

IDEC 강의 계획서 양식_mskim_20170405.doc